Engenharia de Sistemas Embarcados 2006.2 Aula 7: Analisador Lógico.
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Engenharia de Sistemas Embarcados 2006.2Aula 7: Analisador Lógico
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2006.2 Engenharia de Sistemas Embarcados 2
Analisador Lógico
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Analisador Lógico
•Analisador lógico é equipamento de teste de propósito geral
•Provê debug/validação para sistemas digitais
•É conectado ao sistema através de pontas de provas
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A Ponta de Prova
• Proporciona conexão elétrica entre o sistema e o analisador
• Proporciona conexão mecânica do sistema para o analisador
• Ambos são fatores importantes na seleção da ponta de prova
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2006.2 Engenharia de Sistemas Embarcados 5
Quando Usar um Osciloscópio?
• Quando se precisa ver pequenas excursões de sinal
• Quando se precisa de alta precisão no intervalo de tempo
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2006.2 Engenharia de Sistemas Embarcados 6
Quando Utilizar um Analisador Lógico?
• Quando se deseja visualizar vários sinais simultaneamente
• Quando se deseja disparar em um determinado padrão de várias linhas de sinais e visualizar o resultado
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Analisador Lógico
• Ferramenta poderosa para análise de sinais digitais
• Dois modos de operação– Temporização– Estado
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Modo de Operação
• Temporização– Utiliza clock interno de alta velocidade– Permite visualizar cada um dos sinais nos pinos do
circuito– Interessante para o engenheiro de hardware
• Estado– Utilizado para se capturar o estado do processador– Objetivo é visualizar os dados que fornecem
informações relevantes para o processador– Informação de temporização é perdida
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Modo de Temporização
• Semelhante a u osciloscópio
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Modo de Temporização
• Semelhante a u osciloscópio
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Amostragem por Detecção de Transição
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Detecção de Glitches
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Padrão de Disparo
O1O1O1O1
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Padrão de Disparo
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Analisador de Estado
• Estado– É uma amostra de linha ou barramento quando o
dado é válido
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Analisador de Estado
• Analisador de Temporização verificar quando as coisas acontecem em um barramento– Clock interno
• Analisador de Estado verificar o que acontece em um barramento– Clock do sistema
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Analisador de Estado
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Analisador de Estado
Pacote de Disassemblers
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Seqüência de Níveis
• Ajuda a qualificar dados de maneira mais precisa do que com um único ponto de disparo
• Úteis para se achar subrotinas
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Analisar Lógico Embarcado
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Analisador Chip Scope
• Suporta análise lógica e análise do barramento do sistema
• Chip Scope Pro Logic Analysis– Definir e modificar condições de disparo em tempo
real– Visualizar dados em forma de onda ou lista
• Chip Scope Pro Bus Analysis– Definir e modificar condições de disparo em tempo
real– Definir transações e filtros de eventos
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Analisador Lógico Embarcado Signal TapAnalisador Lógico Embarcado Signal Tap
• ELA – Embedded Logic Analyzer• Customizado para um projeto em particular• Não consome área do FPGA
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Getting StartedGetting Started
Projeto Compilado no Quartus
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Open a New Signal Tap FileOpen a New Signal Tap File
File -> New -> Other Files -> SignalTap File -> OK
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Set Clock
Clique … button next to clock name and use node finder
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Gather Signals
Double Click Node Listing and use the Node Finder to add signals
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Set Triggers
Enable Trigger for clear pin Set trigger patternDisable Trigger for other pins Select Pre trigger position
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Set Hardware
Click Setup Click Add Hardware
Double Click ByteBlasterII
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Compile e Programe
Save Signaltap II file and then CompileProgram the FPGA board
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Watch SystemPress Play, Hit Clear button to trigger Signal Tap.